インテルが23億ドルでClassiq買収｜国内シリコン量子開発への波及

米インテル（Intel）は2026年10月26日、イスラエルの量子ソフトウェア企業クラシック・テクノロジーズ（Classiq Technologies）を買収する最終合意を締結しました。日立製作所や産業技術総合研究所（産総研）とともにNEDO事業でシリコン量子コンピュータ開発を進める日本市場にとっても、開発レイヤーの主導権を左右する動きとなります。

量子業界最大となる23億ドル買収の背景と市場データ

インテルによるクラシックの買収対価は、現金とインテル株式を合わせて約23億ドル（約3630億円）に達します。この規模は、量子コンピューティング業界のM&Aとして過去最大です。2025年に米イオンキュー（IonQ）が英オックスフォード・アイオニクス（Oxford Ionics）を買収した際の約10億7500万ドルと比較しても2倍を超える水準となります。

インテル社内におけるイスラエル企業の買収規模としては、2017年のモービルアイ（Mobileye）買収（約153億ドル）に次ぐ過去第2位の投資です。人工知能（AI）チップを手掛けるハバナ・ラボ（Habana Labs）の約20億ドルを上回る規模となります。取引の完了は各国の規制当局による承認を経て、2027年上半期を見込んでいます。

項目	クラシック買収（インテル）	オックスフォード・アイオニクス買収（イオンキュー）
合意時期	2026年10月	2025年
買収総額	約23億ドル（約3630億円）	約10億7500万ドル（約1700億円）
主力事業	量子回路自動合成ソフトウェア	イオントラップ型量子ハードウェア
買収形態	現金およびインテル株式	株式および現金

インテルのリップブー・タン（Lip-Bu Tan）最高経営責任者（CEO）は、かつてケイデンス・デザイン・システムズ（Cadence Design Systems）のCEOとして同社売上を2倍以上に拡大させました。半導体産業を支える電子設計自動化（EDA）の思想を、量子アルゴリズムからハードウェア実装を切り離す基盤ソフトウェアへ適用する狙いがあります。なお、タン氏は2022年のクラシックのシリーズBラウンドに個人投資家として参加していたため、利益相反を避ける目的で今回の正式な買収交渉手続きからは自発的に身を引いています。

マッキンゼー（McKinsey & Company）の2026年推計によると、量子コンピューティングが2035年までに生み出す経済価値は1兆3000億〜2兆7000億ドルに上ります。ハードウェア、ソフトウェア、サービスで構成される量子市場自体も2035年に430億〜710億ドル規模に成長する見通しです。ボストンコンサルティンググループ（BCG）の2026年6月調査では、対象企業の60%以上が量子分野へ年間100万ドル以上を支出しており、投資対象はハードウェアからソフトウェア開発へとシフトしています。

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手動ゲート配置を脱する「Qmod」と合成エンジンの構造

従来の量子ソフトウェア開発では、物理量子ビットの配置や基本的な量子ゲート（CNOTゲート等）の接続を手動で記述する低水準プログラミングが主流でした。この手法は数十量子ビット規模の実証実験では機能しますが、誤り訂正を伴う数千〜数万量子ビットの大規模システムでは人間の設計能力を超えます。

クラシックが開発したプラットフォームは、高水準モデリング言語「Qmod」と独自の論理合成エンジンで構成されます。エンジニアは量子関数や制約条件を抽象度の高いコードで記述し、回路幅（量子ビット数）、回路深さ（ゲート操作ステップ数）、エラー耐性などのパラメータを指定します。合成エンジンは60件以上の関連特許技術を用い、指定された制約を満たす最適なゲート列を自動探索してOpenQASMなどの形式に出力します。

レイヤー	従来の量子開発環境	クラシックの統合スタック
入力インターフェース	物理ゲート単位の直接配置（アセンブラ相当）	高水準モデリング言語「Qmod」（C/Python相当）
最適化プロセス	エンジニアによる手作業の回路圧縮・パルス調整	回路幅・深さ・接続制約に基づく自動論理合成
ハードウェア結合度	対象チップの物理構造に強く依存	ハードウェア非依存（中間表現から各社チップへ変換）
対応実行環境	特定のベンダーSDKごとに個別コード作成	クラウド各社、超伝導、イオントラップ、中性原子等

この論理合成エンジンは、インテルのシリコンスピン方式だけでなく、IBMの超伝導方式、イオンキューのイオントラップ方式、中性原子方式、各種クラウド（AWS、Azure、Google Cloud）にも対応します。インテルは買収後もクラシックのマルチプラットフォーム連携方針を維持することを表明しました。

一方、インテル自身のハードウェア開発は、300ミリメートルウエハーと極端紫外線（EUV）リソグラフィを用いたシリコンスピン量子ビットに注力しています。研究用チップ「Tunnel Falls」は12量子ビットで構成され、素子サイズは約50ナノメートル四方です。超伝導方式などの物理素子と比較して最大100万分の1の小ささを誇り、既存の半導体量産ラインを活用した大規模集積化で先行する技術基盤を持ちます。

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日立・産総研連携と国内企業が直面する開発基盤の選択

クラシックのプラットフォームは日本国内でも導入実績があります。みずほ第一フィナンシャルテクノロジーは2025年4月、Qmodとクラシックのコンパイラを用いて金融工学アルゴリズムの回路圧縮効果を公表しました。東芝やBMW、シティグループ（Citi）なども設計自動化ツールの検証を進めています。

国内のハードウェア開発プロジェクトにも直接関係します。日立製作所とインテル日本法人の共同提案は2026年7月、新エネルギー・産業技術総合開発機構（NEDO）の「量子・AIハイブリッド技術のサイバー・フィジカル開発事業」に採択されました。事業期間は2029年3月までです。

本プロジェクトは産総研との共同研究を通じて、Intel 18A製造プロセスを用いたシリコン量子チップの開発を進めています。2027年度のクラウドサービス提供開始を経て、2028年度に誤り訂正符号を実装した100量子ビット機、2030年度に1000量子ビット機の開発を目指しています。2025年2月には産総研とインテルがMOUを締結し、2030年代前半に産業利用可能な数万量子ビットシステムの実現を掲げています。

開発主体・プロジェクト	目標時期	開発内容・規模
日立・産総研・インテル（NEDO事業）	2027年度	シリコン量子実験環境のクラウドサービス開始
日立・産総研・インテル（NEDO事業）	2028年度	誤り訂正符号を実装した100量子ビット試作機
日立・産総研・インテル（NEDO事業）	2030年度	高密度3次元実装による1000量子ビット機
産総研・インテル（MOU枠組み）	2030年代前半	実用規模となる数万量子ビットシステムの構築

国内の技術責任者が注視すべき点は、クラシックのライセンス体系と中立性の行方です。インテルは他社ハードウェアへの接続維持を明言しているものの、将来的な上位機能の自社ハードウェア優先提供やライセンス変更のリスクは残ります。過去にインテルは高速正規表現ライブラリ「Hyperscan」において、特定バージョン以降を独自ライセンスへ移行させた経緯があります。

国内の素材、金融、製薬企業がアルゴリズム資産を形成するにあたり、オープンソース系フレームワーク（Qiskit等）に閉じるか、商用の合成レイヤーを採用するかで開発効率と将来のベンダーロックインリスクが分かれます。特定方式の物理ハードウェアに依存したコードを書き続けるリスクは、EDA化の潮流によって高まっています。

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